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ARM計劃將四核心CPU引入磁盤驅動器

責任編輯:editor007 作者:于澤 |來源:企業網D1Net  2016-02-18 20:43:54 本文摘自:ZD至頂網

英國處理器設計廠商ARM已經設計出一款四核心Cortex-R8 CPU,旨在幫助存儲驅動器自行應對容量提升帶來的具體需求,同時保證手機設備獲得更出色的下載速度。

Cortex-R家族專門面向實時應用場景,也就是運行在各核心之上的代碼必須在緊迫的設定時限之內對中斷及其它事件做出反應。當源自硬件的信號輸入時,對應代碼開始執行、制定相關決策,隨后將信號重新發送回外設處——整個流程只需耗時數分之一秒。

ARM方面指出,其Cortex-R為目前最為強大的存儲層級CPU架構,且已經為全部磁盤與閃存驅動器制造商所采用。

其中32位ARMv7-R Cortex-R8作為2011年R7的繼任方案最多擁有四個計算核心。這將使其擁有充沛的性能以支撐存儲驅動器,進而實現更為可觀的每秒IO操作、實現更理想的糾錯效果并迎來更低的執行延遲。

基于R8的控制器芯片預計將在未來始終緊跟存儲密度與傳輸速度的發展步伐,這同時意味著我們將在服務器、PC、筆記本以及各類觸控設備中獲得更好的驅動器配置。

R8版本將被用于磁盤服務電機控制、閃存控制器以及未來的5G蜂窩調制解調器當中,而在這些產品層面數分之一秒的差異將決定一套方案的生死存亡。

ARM計劃將四核心CPU引入磁盤驅動器

R8相較于R7迎來一系列重大升級:其擁有一條11級流水線、亂序執行、內存保護單元以避免軟件bug造成的內存損壞、每核心高達2 MB緊密耦合緩存,立足于緩存與內存之糾錯與檢錯機制……

在存儲驅動器或者調制解調器中使用四核心CPU并不是什么天方夜譚。在此類實時嵌入式系統當中,每個計算核心都將作為特定角色執行任務,從而保證其有能力在必要時運行特定線程。

另外,單一核心亦可作為另一核心的冗余機制:兩個核心將運行同樣的代碼。如果兩個核心中的一個發生物理故障,例如內存中發生bit隨機翻轉或者信號延遲,那么二者間的分歧可以得到檢測與糾正。

采用R8核心之系統芯片即將在今年年內以大容量存儲產品的形式亮相。配備這款CPU的5G調制解調器則預計將在兩年或者更遠的未來與用戶見面。

關鍵字:CPU核心實時嵌入式系統

本文摘自:ZD至頂網

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ARM計劃將四核心CPU引入磁盤驅動器

責任編輯:editor007 作者:于澤 |來源:企業網D1Net  2016-02-18 20:43:54 本文摘自:ZD至頂網

英國處理器設計廠商ARM已經設計出一款四核心Cortex-R8 CPU,旨在幫助存儲驅動器自行應對容量提升帶來的具體需求,同時保證手機設備獲得更出色的下載速度。

Cortex-R家族專門面向實時應用場景,也就是運行在各核心之上的代碼必須在緊迫的設定時限之內對中斷及其它事件做出反應。當源自硬件的信號輸入時,對應代碼開始執行、制定相關決策,隨后將信號重新發送回外設處——整個流程只需耗時數分之一秒。

ARM方面指出,其Cortex-R為目前最為強大的存儲層級CPU架構,且已經為全部磁盤與閃存驅動器制造商所采用。

其中32位ARMv7-R Cortex-R8作為2011年R7的繼任方案最多擁有四個計算核心。這將使其擁有充沛的性能以支撐存儲驅動器,進而實現更為可觀的每秒IO操作、實現更理想的糾錯效果并迎來更低的執行延遲。

基于R8的控制器芯片預計將在未來始終緊跟存儲密度與傳輸速度的發展步伐,這同時意味著我們將在服務器、PC、筆記本以及各類觸控設備中獲得更好的驅動器配置。

R8版本將被用于磁盤服務電機控制、閃存控制器以及未來的5G蜂窩調制解調器當中,而在這些產品層面數分之一秒的差異將決定一套方案的生死存亡。

ARM計劃將四核心CPU引入磁盤驅動器

R8相較于R7迎來一系列重大升級:其擁有一條11級流水線、亂序執行、內存保護單元以避免軟件bug造成的內存損壞、每核心高達2 MB緊密耦合緩存,立足于緩存與內存之糾錯與檢錯機制……

在存儲驅動器或者調制解調器中使用四核心CPU并不是什么天方夜譚。在此類實時嵌入式系統當中,每個計算核心都將作為特定角色執行任務,從而保證其有能力在必要時運行特定線程。

另外,單一核心亦可作為另一核心的冗余機制:兩個核心將運行同樣的代碼。如果兩個核心中的一個發生物理故障,例如內存中發生bit隨機翻轉或者信號延遲,那么二者間的分歧可以得到檢測與糾正。

采用R8核心之系統芯片即將在今年年內以大容量存儲產品的形式亮相。配備這款CPU的5G調制解調器則預計將在兩年或者更遠的未來與用戶見面。

關鍵字:CPU核心實時嵌入式系統

本文摘自:ZD至頂網

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